SIwave 仿真信号线下方无铜皮部分的问题

wjdai · 发表于 2009-6-26 10:51

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请教大家一下，SIwave是否不支持信号线下方无铜皮情况的仿真？
大致的情况是这样的：一个直插器件，连接一段PCB走线，直插器件的过孔由于设计原因需要进行一个较大的铜皮避让。这样导致连接直插器件的PCB一段没有参考层，我在设置端口之后，进行仿真，跑到20%，软件报错！
请教一下，这种问题怎么解决呀？！
多谢了！

ab4896 · 发表于 2009-7-2 13:47

自己在下方補個GND plane

emclab · 发表于 2009-7-13 21:54

SIwave中必须有地层

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