高速串并行总线高精度建模与自动化分析

wayne · 发表于 2017-6-6 21:02

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高速串并行总线高精度建模与自动化分析2017年6月22日 - 2017年6月23日
9:00 AM - 5:30 PM (CST)
4000 RMB

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联系人：

Nancy

联系电话：

+86 10 82861715 ext. 102

联系邮箱：

nan.zhang@ansys.com

课程介绍：
随着信号传输速率的提高，电子设备中的串并行总线信号越来越多。这些高速GHz信号具有传输距离远、容量大、布线方便的优点等诸多优点，然而在应用中也存在高速信号完整性问题。在电路设计层面上，高速信号电路面临复杂的时序、眼图、抖动等指标，以及严重的码间干扰（ISI）问题。而传输线、过孔等结构等在高频信号下的趋肤深度等高频特性也都极大影响系统性能
ANSYS是业界领先的CAE仿真软件供应商，其针对高速串并行链路的设计需求和挑战，提供了完整的设计流程和方案。可以帮助设计者完成从传输线、过孔建模，全波电磁仿真，系统链路分析等仿真设计。其中，HFSS作为全波电磁仿真的黄金工具，在业界一直广受推崇，其提供了高效高精度的电磁场算法，而最新版本中集成的HFSS 3D Layout功能，为工程师提供了更加熟悉的EDA设计环境，可以快速高效的分析各类高速信号设计问题。
本次培训主要针对PCB硬件、Layout及SI工程师，内容包括高速串并行链路的仿真方法和手段，为提升相关科技工作者的技术水平，普及ANSYS软件高级功能。因此，ANSYS公司特开办“高速串并行总线高精度建模与自动化分析”。
培训合格者发放ANSYS技术培训认证证书。
培训内容：
第一天：

ANSYS仿真产品体系及技术发展趋势
ANSYS SI仿真流程及方法介绍
HFSS 3D Layout建模及仿真设置
HFSS 3D Layout高速串行链路模型抽取
高速差分链路分析
上机练习：高速差分链路仿真

第二天：

PCB模型导入及仿真设置
PCB DC-Drop分析
PCB去耦电容自动优化分析
DDR并行总线仿真分析
上机练习：DDR并行总线仿真分析
答疑

报名方式：填写最后一页的报名回执表（点击下载）发送 Email： nan.zhang@ansys.com
报名流程和事宜咨询： Nancy， nan.zhang@ansys.com，+86 10 82861715 ext. 102
课程内容及收费咨询：Wendy， hua.lei@ansys.com，+86 10 82861715 ext. 115
培训讲师： ANSYS中国EBU产品技术专家/高级应用工程师
上课时间：2017年6月22日-6月23日（周四-周五）（上午9:00-12:00，下午1:30-5:30）
上课地点：ANSYS北京分公司（地址：北京市海淀区科学院南路2号融科资讯中心C座北楼601室）
收费标准： ￥4000/人（含发票），包括培训费、资料费、证书费和上机费（学员食宿自理）。
特别优惠：

团体报名：￥3200元/人（3人及以上）；5人报名，1人免单
ANSYS老用户：￥3200元/人
维护期内老用户：￥2400元/人
提前2周报名并转账付款，在上述三条基础上再优惠￥200元/人
高校用户：直接5折优惠，￥2000元/人

付款方式：

1. 公对公银行账户转账

2. 私对公银行账户转账

特别说明：

转账学员需提供名片、学生证/工作证的照片或扫描件给Nancy，或采用公司邮箱发邮件给Nancy进行报名
一人支付多人培训费用的情况，转账学员需要通过公司邮箱发出多人的报名信息
报名时的客户公司信息需要与提供的开票信息一致

2017.06.22～06.23_Beijing_ANSYS 高速串并行总线高精度建模与自动化分析.docx (982.8 KB, 下载次数: 0)

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